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数字逻辑学校: 无
问题 1: 1. 下列触发器中，（ ）对输入信号有约束。
选项:
A. 基本R-S触发器
B. 时钟控制T触发器
C. 时钟控制D触发器
D. 时钟控制JK触发器
答案: 基本R-S触发器
问题 2: 2. 组合逻辑电路中的险象是由（ ）引起的。
选项:
A. 电路未达到最简
B. 电路有多个输出
C. 电路中的时延
D. 逻辑门类型不同
答案: 电路中的时延
问题 3: 3. 对电压、频率、电流等模拟量进行数字处理之前，必须将其进行（ ）。
选项:
A. D/A转换
B. A/D转换
C. 直接输入
D. 随意
答案: A/D转换
问题 4: 4. 全加器有（ ）个输出端。
选项:
A. 1
B. 2
C. 3
D. 4
答案: 2
问题 5: 5. n个变量组成的最小项m
选项:
A. n
B. 2n
C. 2
D. 2
-1
答案: n
问题 6: 6. 在下列逻辑部件中，属于组合逻辑电路的是（ ）。
选项:
A. 计数器
B. 数据选择器
C. 寄存器
D. 触发器
答案: 数据选择器
问题 7: 7. 构造1个模5同步计数器，需要（ ）个触发器。
选项:
A. 3
B. 4
C. 5
D. 10
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问题 8: 8. 寄存器要存放n位二进制数码时，需要( )个触发器。
选项:
A. n;
B.
;
C.
;
D. 2/n
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问题 9: 9. 下面哪种不是施密特触发器的应用( )。
选项:
A. 稳定频率脉冲输出
B. 波形变换
C. 脉冲整形
D. 脉冲鉴幅
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问题 10: 10. 下图所示逻辑电路为( )。
选项:
A. “与非”门;
B. 与”门;
C. “或”门;
D. “或非”门
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问题 11: 11. 下列哪个不能用555电路构成( )。
选项:
A. 施密特触发器
B. 单稳态触发器
C. 多谐振荡器
D. 晶体振荡器
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问题 12: 12. 数字系统中，采用( )可以将减法运算转化为加法运算。
选项:
A. 原码
B. 补码
C. Gray码
D. 余3码
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问题 13: 13. 同步计数器和异步计数器比较，同步计数器的显著优点是( )。
选项:
A. 工作速度高
B. 触发器利用率高
C. 电路简单
D. 不受时钟CP控制
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问题 14: 14. 已知某触发器的时钟CP，异步置0端为RD，异步置1端为SD，控制输入端Vi和输出Q的波形如图所示，根据波形可判断这个触发器是( )。
选项:
A. 上升沿D触发器;
B. 下降沿D触发器;
C. 下降沿T触发器;
D. 上升沿T触发器
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问题 15: 15. 下列触发器中，（ ）不能作为同步时序逻辑电路的记忆元件。
选项:
A. D触发器
B. J-K触发器
C. T触发器
D. 基本RS触发器
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问题 16: 16. 实现2个4位二进制数相加的组合电路，应有（ ）个输出函数。
选项:
A. 4
B. 5
C. 6
D. 7
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问题 17: 17. 电平异步时序逻辑电路不允许两个或两个以上输入信号( )。
选项:
A. 同时为0
B. 同时为1
C. 同时改变
D. 同时出现
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问题 18: 18. EPROM是指( )。
选项:
A. 随机读/写存储器
B. 只读存储器
C. 可擦可编程只读存储器
D. 电可擦可编程只读存储器
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问题 19: 19. CMOS数字集成电路与TTL数字集成电路相比突出的优点是( )。
选项:
A. 微功耗
B. 高速度
C. 高抗干扰能力
D. 电源范围宽
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问题 20: 20. 下列选项中，（ ）不是BCD码。
选项:
A. 2421码
B. 8421码
C. 格雷码
D. 余3码
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问题 21: 21. 若已知 XY＋YZ＋YZ=XY＋Z，判断等式(X+Y)(Y+Z)(Y+Z)=(X+Y)Z 成立的最简单方法是依据以下哪种规则( )。
选项:
A. 代入规则
B. 对偶规则
C. 反演规则
D. 互补规则
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问题 22: 22. 小数“0”的补码形式为（ ）。
选项:
A. 0.0…0
B. 00…0
C. 11…1
D. 1.1…1
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问题 23: 23. 脉冲异步时序逻辑电路不允许两个或两个以上输入信号（ ）。
选项:
A. 同时为0
B. 同时为1
C. 同时发生变化
D. 同时出现
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问题 24: 24. （ ）不能清晰的描述电路的逻辑功能。
选项:
A. 状态图
B. 流程表
C. 时间图
D. 总态图
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问题 25: 25. 要使J-K触发器在时钟脉冲作用下，
选项:
A. J=K=0;
B. J=K=1;
C. J=1，K=0;
D. J=0，K=1
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问题 26: 26. 逻辑设计时，采用PLD器件比采用通用逻辑器件更加灵活方便。
选项:
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问题 27: 27. 奇偶校验码能发现错误，不能纠正错误。
选项:
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问题 28: 28. 最简电路不一定是最佳电路。
选项:
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问题 29: 29. 共阴接法的七段显示器，要用有效输出为高电平的显示译码器来驱动。
选项:
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问题 30: 30. CMOS OD 门（漏极开路门）的输出端可以直接相连，实现线与 。
选项:
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问题 31: 31. 由n个变量构成的两个不同最大项M
选项:
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问题 32: 32. 用数据选择器可实现时序逻辑电路。
选项:
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问题 33: 33. 集电极开路门有高电平、低电平、高阻等状态。
选项:
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问题 34: 34. 最简电路不一定是最佳电路。
选项:
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问题 35: 35. 1个触发器可以存放1位十进制数，它具有记忆功能。
选项:
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问题 36: 36. 时钟控制触发器仅当有时钟脉冲作用时，输入信号才能对触发器状态产生影响。
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问题 37: 37. 时序电路不含有记忆功能的器件。
选项:
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问题 38: 38. 同步时序逻辑电路中的存储元件只能是时钟控制的触发器。
选项:
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问题 39: 39. 组合逻辑电路有记忆功能。
选项:
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问题 40: 40. 同步二进制计数器的电路比异步二进制计数器复杂，所以实际应用中较少使用同步二进制计数器。
选项:
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问题 41: 41. 二进制译码器相当于是一个最小项发生器，可以用其实现组合逻辑电路。
选项:
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问题 42: 42. 若两个函数具有不同的逻辑函数式，则两个逻辑函数必然不相等。
选项:
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问题 43: 43. 一个真值表可能对应多个逻辑函数表达式。
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问题 44: 44. 同步时序电路具有统一的时钟 CP 控制。
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问题 45: 45. 异步时序电路的各级触发器类型不同。
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问题 46: 46. 奇偶校验码不但能发现错误，而且能纠正错误。
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问题 47: 47. 设计一个同步模5计数器，需要5个触发器。
选项:
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问题 48: 48. 计数器的核心元件是触发器。
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问题 49: 49. 由逻辑门电路构成的电路是组合逻辑电路。
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问题 50: 50. 采用串行加法器比采用并行加法器的运算速度快。
选项:
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发表于 2024-11-27 08:18:00
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